Realization of Memory Fault Tolerance using Error Correcting Codes
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44,99 €
inkl. gesetzl. MwSt.,
Beschreibung
Produktdetails
Einband
Taschenbuch
Erscheinungsdatum
08.02.2017
Verlag
LAP LAMBERT Academic PublishingSeitenzahl
128
Maße (L/B/H)
22/15/0,9 cm
Gewicht
209 g
Sprache
Englisch
ISBN
978-3-330-04419-7
This work is aimed towards the implementation of a fault-tolerant memory system with the help of supporting circuits. This work demonstrates an improvement on the reliability of a semiconductor memory system using Error control codes (ECC)and Low Density Parity Check (LDPC) Codes as a part of protecting support logic. It is observed that the error correcting codes with higher hamming distances can detect more errors i.e. as higher the hamming distance higher the error control capability.
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